1樓：
焊盤與keep-out layer層(外框)太近，你將這個器件放置離keep-out layer層遠的地方看看是否綠色消除，如果消除就是我說的，這個設定一下設計規則，如果沒有你再發追問吧。
在altium designer winter 09中進行pcb設計時，焊盤都變成了綠色，這是怎麼回事？
2樓：巴楚崔羅
也不一定是元件疊加，你快捷點d+r設定一下就ok了，若實在不行，就這樣佈局，然後快捷鍵：t+m
就好。希望採納。
altium designer 中pcb 焊盤點處怎麼出現綠色了
3樓：匿名使用者
原因：出現亮綠色主要是出現錯誤造成
解決方法：
錯誤的原因很多，需要根據實
版際情況解決：權
1、如果元器件過近引起的，設定下安全間距。
2、周圍的元器件重疊，只需要挪動元器件到新的位置，就可以解除。
3、有時候設定不合理，原理圖和設計規則制定不合理，也會發生綠色。根據實際進行修改即可。
altium designer 10由於位置關係 元件變綠
4樓：匿名使用者
設定裡面有啊，話pcb板子之前先設定好規則再往下做，design=>rules...在裡面可以設定線寬、孔徑、焊盤大小等等的規則，不符合規則則變綠色。你也可以用design=>rule wizard...
進行畫板前的設定。我很好奇你是什麼元件需要重疊位置，難道是器件擺放空間交錯了
5樓：匿名使用者
關閉rule=>placement=>***ponent clearance這個規則就行了，我也遇到過很多次這個問題，硬是一個個規格給試出來的。絕對正解。
6樓：匿名使用者
選擇「工具」選單下的「復位錯誤標誌」
7樓：匿名使用者
應該是違反了clearance裡最小間距的設定，還有可能是絲印相關的最小間距設定，你可以***pile一下原理圖，根據message裡的提示更改相應的規則。其實只要你確認沒問題，管它變不變綠呢，又沒什麼影響，直接把錯誤指示關了都行。
altium designer中，元件的引腳總是變綠，不知道怎麼調。。。 5
8樓：冷寂人生
出現錯誤不bai一定是焊盤與焊盤之間的
du間距不夠，也
zhi有可能是其dao他規則不符合。比如絲印回的距離答，綠油的距離等。另外看你第二張圖，說的是元件的間距是0.
1mm，指的是元件與元件之間的間距，但是元件本身的焊盤與焊盤間距不適用這個規則。不知道你的clearance_1裡面的間距是多少呢？另外你可以把圖放大，就可以看到用白色標示出來的錯誤到底是什麼，如我下面的標示。
9樓：上帝弟弟
有個忽略同一個封裝的間距選項，打上勾就行了
altium designer pcb設計介面貼片器件焊盤顯綠色 ，並且上面有白色的大於30mil,怎麼修改規則才能改好？
10樓：jasonhello是我
你的問題也沒看懂。你的意思是修改規則，以便可以畫大的焊盤嗎？
11樓：匿名使用者
貼個圖，才能告訴你是什麼問題。
altium designer裡面，如圖，焊盤為什麼是綠色的？
12樓：匿名使用者
我都已經看到，綠色焊盤左上角有個紫色點。那是禁止佈線層的顏色。你看看去掉是不是好了。
另外你仔細查一下，焊盤底下是不是有不同網路的東西或其他異物。焊盤疊加也不可以，除非是同一網路。
如果過孔能引起綠色，那你已經自行設定比較高階的規則了。如果是過孔引起的，你把孔徑設定為0就可以了。
13樓：匿名使用者
這肯定是違反了規則，你這是焊盤，不能當過孔(via)來設計規則，而是要在holesize裡進行設定。
具體是在：manufacturing->hole size->holesize。
請試下吧，應該可解決問題。
14樓：二月三十
焊盤邊上有個粉紅色線，去掉，就ok了，試試吧
15樓：匿名使用者
有可能過孔的網路和中間焊盤的不是同一網路。。
altium designer pcb 封裝變為綠色
16樓：匿名使用者
可能是元器件的佈局間距超過了安全間距的設定，你可以將元器件手動適當布開點，再佈線看看。
17樓：匿名使用者
erc規則檢查出錯。一定是你的焊盤重疊了。間距不夠造成erc出錯。
求助各位altium designer的高手，原理圖匯入pcb後，由於晶片引腳太小總是報錯（變綠）怎麼辦？
18樓：匿名使用者
1.首先設定兩個bai不同的優先順序du順序的設zhi置，如上圖
2.在第一個dao優先順序設定上設定你需專要屬的全域性佈局中元器件所需要的間距，並在這個打勾，說明忽略封裝裡面的pad之間的距離
3.在第二個優先順序上的最小間距上填上你器件引腳間的間距，可以自己量，然後勾去掉，最後按ok，就行了。
19樓：匿名使用者
這樣的drc 錯誤
抄是 規則設定裡
襲的 electrical/clearance/clearance 最小間bai距引數引du起的。
比較簡單zhi的做法，一是disable 這條規則，二是把最小間距改得更小。
但是這dao兩個做法都是全域性修改，整個pcb 設計的線路間距都會受到影響，只要間距不小於設定的值都將不會報錯。
比較推薦的做法是，只針對這個晶片，在 electrical/clearance 下新建一條規則，兩個條件分別是 all，in***ponent(u1)，間距設定成小於等於晶片引腳間距的值。（注：u1是我隨意填的，這裡實際要填這個晶片在pcb 上的 designator。
）只要這條規則優先順序高於全域性規則的那條，就既可以滿足該晶片引腳不報錯的要求，又不會影響全域性的drc 檢查。
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